xlinx vivado设计过程中的时序约束问题

Vivado工程经验与时序收敛技巧：

https://blog.csdn.net/shshine/article/details/52451997

如何解决fpga high fanout问题：

https://blog.csdn.net/shshine/article/details/52451997

(* KEEP="TRUE" *)使用：

https://www.cnblogs.com/6852w/p/11266680.html

Hold time 违例解决：

https://forums.xilinx.com/t5/Timing-Analysis/Fixing-Hold-violation/td-p/282744

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